The Design of a 2.7 V, 200 MS/s, and 14-Bit CMOS D/A Converter with 63 dB of SFDR CHaracteristics for the 90 MHz Output Signal

• Autores: H. Sakurai, Y. Sugimoto
• Localización: IEICE transactions on electronics, ISSN 0916-8524, Vol. 86, Nº 6, 2003, págs. 1077-1084
• Idioma: inglés
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